设计思路:

(1)       一旦检测到按键资源按下(从高电平到低电平),“电平检测模块”就会拉高H2L_Sig电平,然后拉低。

(2)       “10ms延迟模块”检测到H2L_Sig高电平,就会利用10ms过滤H2L_Sig,拉高输出。

(3)       当按键被释放,“电平检测模块”会拉高L2H_Sig电平,然后拉低。

(4)       “10ms延迟模块”检测到L2H_Sig就会利用10ms过滤L2H_Sig然后拉低输出。

模块:

 /***********************************************************
module name: detect_module.v
function: detect pin's level change by yf.x
2014-11-05 ************************************************************/ module detect_module(
CLK,
RST_n,
Pin_in,
H2L_Sig,
L2H_Sig
); input CLK;
input RST_n;
input Pin_in;
output H2L_Sig;
output L2H_Sig; /**************************************************************/
//DE2-115 use 50MHz oscillator,50M*0.0001-1=4_999
parameter T100us='d4999; /**************************************************************/ reg [:]count1;
reg isEn; always @(posedge CLK or negedge RST_n) //100us timer
if(!RST_n)
begin
count1<='d0;
isEn<='b0;
end
else if(count1==T100us)
isEn<='b1;
else
count1<=count1+'b1; /***********************************************************/ reg H2L_F1;
reg H2L_F2;
reg L2H_F1;
reg L2H_F2; always @(posedge CLK or negedge RST_n)
if(!RST_n)
begin
H2L_F1<='b1;
H2L_F2<='b1;
L2H_F1<='b0;
L2H_F2<='b0;
end
else
begin
H2L_F1<=Pin_in;
H2L_F2<=H2L_F1;
L2H_F1<=Pin_in;
L2H_F2<=L2H_F1;
end /*****************************************************/ assign H2L_Sig=isEn?(!H2L_F1&H2L_F2):'b0;
assign L2H_Sig=isEn?(!L2H_F2&L2H_F1):'b0; /*****************************************************/ endmodule
 /***************************************************
module name: delay_module.v
function: delay 10ms. by yf.x
2014-11-05 ***************************************************/ module delay_module(
CLK,
RST_n,
H2L_Sig,
L2H_Sig,
Pin_out
); input CLK;
input RST_n;
input H2L_Sig;
input L2H_Sig;
output Pin_out; /**************************************************/
//5M*0.001-1=49_999
parameter T1ms='d49_999; /**************************************************/ reg [:]count1; always @(posedge CLK or negedge RST_n)
if(!RST_n)
count1<='d0;
else if(iscount && count1==T1ms)
count1<='d0;
else if(iscount)
count1<=count1+'b1;
else if(!iscount)
count1<='d0; /****************************************************/ reg [:]count_ms; always @(posedge CLK or negedge RST_n)
if(!RST_n)
count_ms<='d0;
else if(iscount && count1==T1ms)
count_ms<=count_ms+'b1;
else if(!iscount)
count_ms<='d0; /*******************************************************/ reg iscount;
reg rPin_out;
reg [:]i; always @(posedge CLK or negedge RST_n)
if(!RST_n)
begin
iscount<='b0;
rPin_out<='b0;
i<='d0;
end
else
case(i)
'd0:
if(H2L_Sig)
i<='d1;
else if(L2H_Sig)
i<='d2; 'd1:
if(count_ms=='d10)
begin
iscount<='b0;
rPin_out<='b1;
i<='d0;
end
else
iscount<='b1; 'd2:
if(count_ms=='d10)
begin
iscount<='b0;
rPin_out<='b0;
i<='d0;
end
else
iscount<='b1;
endcase /**************************************************/ assign Pin_out=rPin_out; /**************************************************/ endmodule
 /****************************************
module name: debounce_module.v
function: debounce a key
pin assignments(for DE2-115):
---------------------------------
CLK----------------------CLOCK_50
RST_n--------------------KEY[0]
Pin_in-------------------KEY[3]
Pin_out------------------LEDG[3] ****************************************/ module debounce_module(
CLK,
RST_n,
Pin_in,
Pin_out
); input CLK;
input RST_n;
input Pin_in;
output Pin_out; /*******************************/ wire H2L_Sig;
wire L2H_Sig; detect_module u0(
.CLK(CLK),
.RST_n(RST_n),
.Pin_in(Pin_in), //input from top
.H2L_Sig(H2L_Sig), //output to u1
.L2H_Sig(L2H_Sig) //output to u1
); /***************************************/ delay_module u1(
.CLK(CLK),
.RST_n(RST_n),
.H2L_Sig(H2L_Sig), //input from u1
.L2H_Sig(L2H_Sig), //input from u1
.Pin_out(Pin_out) //output to top
); /***************************************/ endmodule

疑问:

(1)       iscount的作用?

使能2个计数器(count1和count_ms)。

(2)       延迟10ms的目的?

过滤H2L_Sig和L2H_Sig。

detect_module里延迟100us,过滤最初的不稳定状态,至于为何用100us,猜的。

模块框图:

实验三结论:

功能模块对功能模块的组合建模。

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