SystemVerilog 带输出的task
1. soc looks like
soc 系统由主控和从机构成，mux负责对master的地址进行地址译码，然后选中某个slave进行读写操作，
各个IP的验证环境应该景可能多的考虑soc中的复杂场景，进行验证。
2. N master 1 slave little soc heri looks like
3. 1 master multi slave little soc heri looks like
4. soc connection performance
1.延迟
2.带宽
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