【lattice软核】ROM的使用
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一、ROM核调用:==================》》》》》
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二、ROM表的生成:==================》》》》》
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查看内存使用手册,如图可以找到,我的是MachXO2系列芯片
在手册中查看.mem文件需要的格式
了解了文件数据格式,那么就需要编写数据了,数据可以自己计算来填写,比如编一个1024*8的正弦波表,但是手工麻烦
下面介绍下工具,我暂时没找到更好的工具,如果大家有更好的工具希望能告知。当然也可以用execl,matlab等实现。
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使用方法
1、查看--全局参数里设置一下
2、点设定波形--正弦波。就有了波形数据了
3、点保存,保存为mif文件。 此时保存的文件和.mem需要的内容格式不同,需要手动修改,打开文件如图
每行后的分号也需要去掉哦
在最后一行还有个END,记得删除
4、另保存为.mem格式(记事本似乎不可以竖列选,我用的是notepad++,其他高级编辑器也都可以)
5、回到IP核调用那块重新调用,把这个文件添加进去,选择hex文件格式的,生成
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三、ROM软核添加进工程:==================》》》》》
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1、打开工程目录,找到刚才省成的rom.v文件,拖放到diamond的source文件
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四、rom核的使用:==================》》》》》
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我现在要写一个ROM直接接DAC输出正弦波的,则要考虑时序,查看手册
DAC的时序如下
具体分析自己看,可以看出需要在时钟下降沿改变地址,上升沿时保持稳定
则代码如下
/*--------------------------------------------------------------------------------------
-- Filename ﹕ dac.v
-- Author ﹕tony-ning
-- Description ﹕DAC硬件测试 ,10M方波,AD9760
-- Called by ﹕Top module
-- Revision History ﹕15-10-16
-- Revision 1.0
-- Company ﹕
-- Copyright(c) All right reserved
---------------------------------------------------------------------------------------*/ module dac
(
input CLK25, //输入25M时钟
output CLK_DA,//输出给DAC的100M时钟
output [:]date_out
); reg [:]count2; always @( negedge CLK)//地址累加,下降沿改变
begin
count2<=count2+;//改变累加数字可改变输出频率
end assign CLK_DA=CLK;//时钟输出 pll PLL100M//锁相环倍频
(
.CLKI(CLK25),
.CLKOP(CLK)
); rom_sin sin//调用rom核,
(
.Address(count2), //地址
.OutClock(CLK), //时钟
.OutClockEn('b1), //输出使能,高有效
.Reset('b0), //复位,高有效
.Q(date_out)
); endmodule
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