在学习ZYNQ时会遇到不少问题,这时我们一方面要在DocNav找Xilinx的官方文档,另一方面要参考别人的一些记录的解决好的办法,我在学习的时候看到了不少大佬的博客,给我带来了很大帮助。在这篇博客,我将持续更新一些主题下的大佬博客,记录自己的学习,也感谢这些大佬愿意分享他们解决问题的方法!

了解Xilinx

FPGA、Zynq 和 Zynq MPSoC简析及架构分析

vivado使用

vivado SDK 2017.4中的project explorer窗口被关闭后如何打开

Xilinx SDK导入项目报错,缺少头文件,引入头文件过程

仿真

抓取Vivado仿真数据导入Matlab分析

Testbench编写指南(2)文件的读写操作

ILA

Vivado自带ILA数据导出到MATLAB分析

FIR

Vivado FIR滤波器IP核实现

数字信号处理与FPGA

FPGA数字信号处理(一)数字混频(NCO与DDS的使用)

引脚约束

FPGA Vivado XDC 约束文件编写方式语法笔记

vivado怎么解决Unconstrained Logical Port [DRC NSTD-1] [DRC UCIO-1]错误

文件格式

FPGA中.mif文件的创建和使用

防止综合

Quartus II防止信号被综合

ZYNQ嵌入式开发

Zedboard(四)嵌入式应用程序开发——实例三:写入数据到SD卡

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