modesim 仿真问题

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pll及其modesim仿真

100mhz输入时钟,pll层40mhz和200zhm 进入quartus,建立工程,新建图形文件,导入pll模块,设定pll相关参数. 完成pll模块的建立,并生成pll.v文件建立modesim工程对pll模块进行打包建立激励文本pll_module_tp 这样,modesim工作目录中除了pll.v, pll_module.v, pll_module_tp文件外,还需加入alter仿真库文件(如果modesim软件添加过alter库,这不需要) 进行编译编译完成后,simula…

> unisim (ERROR: Library path "d:/Xilinx/14.3/ISE_DS/ISE//vhdl/mti_se/10.1a/nt64/unisim/unisim" does not exist)ERROR: The library path specified in the 'modelsim.ini' file for mapping the 'unisim' >解决办法找到工程文件夹,把里面的 modelsim.ini 删掉,然后再点仿真按…

Normal synchronous FIFO mode 和 Show-ahead synchronous FIFO mode

FIFO是先进先出,可以用fifo来处理跨时钟域的数据传输问题,用到的地方特别多,一定要搞会. 在学习调用fifo的IP核中发现有normal synchronous FIFO mode 和 Show-ahead synchronous FIFO mode这两种模式,就研究一下. 研究 IP 核最方便的方式就是用 modesim 仿真一下,这样关系就会很明了. 下面的两幅图是我用 Time_Gen 软件自己总结画的,并不是 modesim 的仿真图. 假定存入fifo的第一个数是01,第二个数是…

verilog写的LCD1602 显示

在读本文之前,请先阅读 LCD1602 的 datasheet(百度到处都是) ,熟悉有关的11条指令集. LCD1602的11个指令集链接 http://www.cnblogs.com/aslmer/p/5801363.html(这是我总结的11条指令集,中英文结合) 1.LCD1602基础知识 (2)LCD1602操作流程 2.代码: module lcd_1602_driver( clk , rst_n , lcd_en , lcd_rw , //因为只执行写操作,所以永远为0. lcd_…

向modesim中添加alter库（或者在每次仿真时将库文件加入仿真文件夹一起编译）

在ModelSim中进行仿真需要加入Quartus提供的仿真库,原因是下面三个方面: ·Quartus不支持Testbench: ·调用了megafunction或者lpm库之类的Altera的函数: ·时序仿真要在Modelsim下做仿真. 下面以Altera器件为例,介绍如何在ModelSim中加入Altera的仿真库,Quartus II软件中自带有Altera的仿真库,只要把它拿到ModelSim中去编译一下就可以了,具体步骤如下:1.设置仿真库路径打开M…

通过文件读写方式实现Matlab和Modelsim的联合仿真

虽然Modelsim的功能非常强大,仿真的波形可以以多种形式进行显示,但是当涉及到数字信号处理的算法的仿真验证的时候,则显得有点不足.而进行数字信号处理是Matlab的强项,不但有大量的关于数字信号处理的函数,而且图形显示功能也很强大,所以在做数字信号处理算法的FPGA验证的时候借助Matlab会大大加快算法验证的速度. 关于Matlab和Modelsim联合仿真,我从网上看到两种方法,一种是通过Link for Modelsim建立Matlab和Modelsim的联合仿真接口:另一种就是通过文…