之前在看Altera的官方教程上就有说明,如果我们定义一个reg [`word_w]user_ram[`word_d]  ; QuartusII会自动综合成为一个ram—— 当然有一些前提:(后续补充) 今天就这个知识点看QuartusII 的反应如何 .因为最近在看<CPU自制入门> 我选定的DE1-SOC只有3w多个lab,我移植了原始的工程编译居然提示需要10w个lab,所以分析与综合过了之后place的时候就挂掉了,提示lab不足.所以就在折腾哪里可以节省资源 在gpr.v 里面刚好有…

1)所有综合工具都支持的结构:always,assign,begin,end,case,wire,tri,aupply0,supply1,reg,integer,default,for,function,and,nand,or,nor,xor,xnor,buf,not,bufif0,bufif1,notif0,notif1,if,inout,input,instantitation,module,negedge,posedge,operators,output,parameter.     (2…

实验现象: 核心代码: module single_port_ram( input CLK_12M, input WR, input RD, input CS0, inout [:]DB, input [:]A, output FPGA_LEDR, output FPGA_LEDG, output FPGA_LEDB ); //----------------------------pll-------------------------------// /*实例化MY_PLL模块,输出48M时…

转自http://bbs.ednchina.com/BLOG_ARTICLE_1770084.HTM 基础知识:verilog 不可综合语句  (1)所有综合工具都支持的结构:always,assign,begin,end,case,wire,tri,aupply0,supply1,reg,integer,default,for,function,and,nand,or,nor,xor,xnor,buf,not,bufif0,bufif1,notif0,notif1,if,inout,input…

FPGA中的嵌入式RAM分为两种:专用的BRAM和分布是RAM(用LUT实现的).这两种RAM又可以配置成单端口和双端口的RAM和ROM.双端口RAM又可以根据读写地址是否在同一块分为Double Port 和Two Port.读取方式也有多种方式,包括:Read first, Write first, No change 等. Block RAM和分布式RAM 在FPGA实现RAM时,可在专用Block RAM和分布式RAM中实现.这两者的选择不仅会影响资源选择,同时还会严重地影响性能和功耗.…

在本篇里,我们讨论 Verilog 语言的综合问题,Verilog HDL (Hardware Description Language) 中文名为硬件描述语言,而不是硬件设计语言.这个名称提醒我们是在描述硬件,即用代码画图. 在 Verilog 语言中,always 块是一种常用的功能模块,也是结构最复杂的部分.笔者初学时经常为 always 语句的编写而苦恼,不知道使用哪种赋值语句,不了解两种赋值之间的区别.究其本质是对 always 语句的综合一知半解,常年使用软件思维编写代码所致. 现在…

1, 若需要修改memory mode, 需重新编译; 若不需要修改memory mode, 直接修改宏参数即可; 2, 宏参数列表: 3, 注意用LE搭memory的情况; 4, memory type与读写触发边沿(triggering) 注意,read/write triggering与地址/数据锁存是有区别的. 把triggering point理解为实际读/写发生的时间点,可以是上升沿或者下降沿:但地址/数据的锁存永远是在上升沿发生的. 5, 名词解释 -- continuous re…

题记:这个笔记不是特权同学自己整理的,特权同学只是对这个笔记做了一下完善,也忘了是从那DOWNLOAD来的,首先对整理者表示感谢.这些知识点确实都很实用,这些设计思想或者也可以说是经验吧,是很值得每一个有志于FPGA/CPLD方面发展的工程师学习的. 1.硬件设计基本原则 (1).速度与面积平衡和互换原则:一个设计如果时序余量较大,所能跑的频率远高于设计要求,能可以通过模块复用来减少整个设计消耗的芯片面积,这就是用速度优势换面积的节约:反之,如果一个设计的时序要求很高,普通方法达不到设计频率,那…

我之前用过的CPLD有Altera公司的MAX和MAX-II系列,主要有两个优点:1.程序存储在片上Flash,上电即行,保密性高.2.CPLD器件规模小,成本和功耗低,时序不收敛情况也不容易出现.缺点也很明显:1.没有片上RAM,无法对数据进行高速暂存和处理:2.没有PLL,使用一个以上的高频时钟非常不方便:3.没有小封装产品,MAX-II最小的EPM240也是LQFP100封装.近年来,随着Altera被Intel收购,对MAX-II的支持力度不断降低,当前EPM240的价格也达到了百元左右…

iCore3 Demo V1.0 程序说明 一.概要 本资料包包含5个文件夹: 1.“arm”里是 icore3上 arm的程序包,开发环境为 KEIL 5.17: 2.“fpga”里是 icore3 上 fpga的程序包,开发环境为 QuartusII 15.0(好像低版本的也可以打开): 3.“相关软件”里包含 putty 终端软件和 UDP 调试软件: 4.“屏幕截图”为工作时的截图: 5.“驱动”为板载 usb 转 uart的驱动程序,本实验之前需要安装到计算机. 二.测试准备工作 为了…