ISE14.7使用教程（一个完整工程的建立）

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ISE14.7使用教程（一个完整工程的建立）

FPGA公司主要是两个Xilinx和Altera(现intel PSG),我们目前用的ISE是Xilinx的开发套件,现在ISE更新到14.7已经不更新了,换成了另一款开发套件Vivado,也是Xilinx的产品,intel的开发套件是Quartus II系列,我们实验室这两款公司的开发板都有,不过对于入门来说,选择ISE有两个原因,一是它比Vivado快多了,二是它和Quartus II相比不用自己写测试文件(激励).实验室的板子这两个公司都有,代码都是可以移植的,学习的话都要学的,软件不是问…

Modelsim10.2c使用教程（一个完整工程的仿真）

之前玩过Altera的板子,不不, 现在应该叫intel PSG.在QuartusII13.0上老喜欢用modelsim_ae做仿真,小工程用起来也方便,但是我做IIC配置摄像头的时序仿真时,就显得有些吃力,所以还是用modelsim_se才是正点. 以前老想用QuartusII和modelsim单独仿真,找了很多方法都没有实现,但看了一个前辈的视频后,一下改变了我的想法,光使用modelsim也可以完成一个工程的建立,而且在建立工程的时候将代码,仿真,和ip都分类管理,会更加方便后面的工程设计…

Vivado2015.4使用教程（一个完成工程的建立）

双击桌面的vivado图标,(可能有点慢) 弹出主菜单界面,点击create new project 这是介绍界面,next~ 添加好工程名,和工程位置,next~ 选择rtl Project,next~ 选择板卡型号,我这里使用的是A-7系列的basys3,用户根据自己的板卡型号自定义,next~ 这一面是总结,finish~ 左边这一栏,我们用到哪里解释哪里,首先,点击add source 添加verilog HDL文件选择新建一个设计文件,next~ 左边是添加已有的文件,右边是新建一个…

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QuartusII13.0使用教程详解（一个完整的工程建立）

好久都没有发布自己的博客了,因为最近学校有比赛,从参加到现在都是一脸懵逼,幸亏有bingo大神的教程,让我慢慢走上了VIP之旅,bingo大神的无私奉献精神值得我们每一个业界人士学习,向bingo致敬.之前一直没有发布博客,是因为比赛实在是太麻烦了,像我这种学习能力又不是很强,智商也不是很高的...所以大部分时间都在忙比赛上,可以说是从零学起,我们实验室偏向xilinx,最近发现有几个比较高端的板子,来了兴趣,还是等暑假有时间在学习吧.在学校我就尽量保持每个月都发布一次博客,给自己做一个总结.最…